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Cardinal鎖相環(huán)基礎(chǔ)知識(shí),CFVL-A7BP-156.25TS

來源：http://m.lbfp.com.cn 作者：億金電子 2024年03月02
Cardinal鎖相環(huán)基礎(chǔ)知識(shí)
鎖相環(huán)導(dǎo)論
鎖相環(huán)(PLL) 電路用于頻率控制。他們可以配置為頻率乘法器、解調(diào)器， 跟蹤發(fā)電機(jī)或時(shí)鐘恢復(fù)電路。每個(gè)這些應(yīng)用要求不同的特征，但是他們都使用相同的基本電路概念。
圖1包含一個(gè)模塊基本PLL示意圖倍頻器。這該電路的操作是典型的全鎖相循環(huán)。這基本上是一種反饋控制系統(tǒng)控制電壓控制的相位貼片振蕩器(VCO)。輸入信號(hào)施加到一個(gè)輸入端相位檢測器。其他的輸入連接到N分頻的輸出 柜臺(tái)。通常情況下 兩個(gè)信號(hào)的頻率將 幾乎一樣。這鑒相器的輸出為 與電壓成比例的電壓 之間的相位差兩個(gè)輸入。這個(gè)信號(hào)是應(yīng)用于環(huán)路濾波器。它是環(huán)路濾波器決定的動(dòng)態(tài)特征 鎖相環(huán)。濾波后的信號(hào)控制VCO。注意到VCO的輸出為a N倍的頻率提供給的輸入頻率參考輸入。


Cardinal鎖相環(huán)基礎(chǔ)知識(shí)
這個(gè)輸出信號(hào)被發(fā)送回來 通過連接到鑒相器 除以N計(jì)數(shù)器。
通常環(huán)路濾波器是旨在匹配 要求的特征PLL的應(yīng)用。如果PLL將獲取并跟蹤a 用信號(hào)表示環(huán)路的帶寬 過濾器將大于如果它期望固定的輸入頻率。 頻率范圍PLL將接受并鎖定is 稱為捕獲范圍。一次PLL鎖定并跟蹤 頻率范圍內(nèi)的信號(hào) PLL將遵循的是 稱為跟蹤范圍。通常跟蹤范圍是 大于捕獲范圍。 環(huán)路濾波器還確定。
信號(hào)頻率有多快 可以改變并且仍然保持鎖定。這是最大值 回轉(zhuǎn)率。越窄環(huán)路濾波器帶寬可實(shí)現(xiàn)的階段越小 錯(cuò)誤。這是在 響應(yīng)速度變慢的代價(jià)和縮小的捕獲范圍。
典型的例子 PLL動(dòng)態(tài)測量 響應(yīng)如圖2所示。 該P(yáng)LL用于頻率合成器和顯示了對80的響應(yīng)10MHz中的kHz步進(jìn) 參考輸入。這個(gè)電路 捕捉范圍約為中心頻率的+/- 5%

 
Cardinal鎖相環(huán)基礎(chǔ)知識(shí)
請注意，石英晶振的頻率 垂直軸PLL顯示a 50 %超調(diào)。這稍微欠阻尼響應(yīng)為a 達(dá)成妥協(xié) 更快的壓擺率容差和 中等捕獲范圍。
有各種各樣的方法 LeCroy示波器可以 用于PLL測量。 現(xiàn)代、高性能 微處理器通常采用 內(nèi)部PLL用于乘以系統(tǒng)時(shí)鐘頻率。這 制造商指定 最大循環(huán)周期 上允許的變化 系統(tǒng)時(shí)鐘。典型的 規(guī)格是 最大抖動(dòng)小于250° ps峰對峰。自從 PLL的輸出不是 重要的是 系統(tǒng)時(shí)鐘輸入滿足這一點(diǎn) 規(guī)格。
工程師可以 驗(yàn)證系統(tǒng)時(shí)鐘通過以下方式滿足本規(guī)范 測量系統(tǒng)時(shí)鐘 使用抖動(dòng)跟蹤循環(huán)來循環(huán)。 這如圖3所示。 在100 us記錄中最大循環(huán)周期 差70 ps。這個(gè)值 是直接從抖動(dòng)跟蹤周期到周期 軌跡c中的波形。該區(qū)域 在垂直參數(shù)之間 光標(biāo)標(biāo)記最大值。 跡線A是 采集的數(shù)據(jù)并顯示 兩個(gè)相鄰的循環(huán)最大差異。 軌跡B是抖動(dòng)軌跡讀取絕對值的周期 的每個(gè)周期的周期 時(shí)鐘波形。貼片石英晶振
如果PLL是可訪問的，LeCroy 范圍可用于驗(yàn)證 鑒相器的線性度 通過繪制平均值的趨勢 輸出電平與輸入相位的關(guān)系 差異。
勒羅伊示波器提供了一個(gè) 各種測量 表征相位的工具 鎖定循環(huán)。抖動(dòng)和時(shí)序分析是以下方面的主要工具 這些精度評估 時(shí)基電路。
 
什么是壓控晶振？壓控晶振(VCXO)是一種石英晶體振蕩器，其振蕩效率可以通過紅外線加控制電壓來改變或調(diào)制。它的振蕩頻率由晶體決定，頻率可以通過控制電壓在小范圍內(nèi)調(diào)節(jié)。VCXO多用于鎖相技術(shù)和頻率負(fù)反饋調(diào)制。通常，控制電壓范圍為0V至2V或0V至3V。VCXO的調(diào)諧范圍為100ppm至200ppm。壓控晶振主要由石英諧振器、變?nèi)荻O管和振蕩電路組成。其工作原理是通過控制電壓來改變變?nèi)荻O管的電容，從而“拉動(dòng)”石英諧振器的頻率，達(dá)到調(diào)頻的目的。

原廠編碼 品牌 系列 Description描述
CVFSC7 Cardinal晶振 CVFSC OSC VCXO 622.08MHZ CMOS SMD
CVFSE7 Cardinal晶振 CVFSE OSC VCXO 622.08MHZ PECL SMD
CVFSV7 Cardinal晶振 CVFSV OSC VCXO 622.08MHZ LVDS SMD
CV622E9 Cardinal晶振 CV622E OSC VCXO 622.08MHZ PECL SMD
CV622V9 Cardinal晶振 CV622V OSC VCXO 622.08MHZ LVDS SMD
C3VFSC7 Cardinal晶振 C3VFSC OSC VCXO 311.04MHZ CMOS SMD
C3VFSE7 Cardinal晶振 C3VFSE OSC VCXO 311.04MHZ PECL SMD
C3VFSV7 有源晶振 C3VFSV OSC VCXO 311.04MHZ LVDS SMD
CFVE-A7BP-155.52TS Cardinal晶振 CFVE OSC VCXO 155.52MHZ LVPECL SMD
CFVE-A7BP-156.25TS Cardinal晶振 CFVE OSC VCXO 156.25MHZ LVPECL SMD
CFVE-A7BP-212.5TS Cardinal晶振 CFVE OSC VCXO 212.50MHZ LVPECL SMD
CFVE-A7BP-311.04TS Cardinal晶振 CFVE OSC VCXO 311.04MHZ LVPECL SMD
CFVE-A7BP-622.08TS Cardinal晶振 CFVE OSC VCXO 622.08MHZ LVPECL SMD
CFVED-A7BP-155.52TS Cardinal晶振 CFVED OSC VCXO 155.52MHZ LVPECL SMD
CFVED-A7BP-156.25TS Cardinal晶振 CFVED OSC VCXO 156.25MHZ LVPECL SMD
CFVED-A7BP-212.5TS Cardinal晶振 CFVED OSC VCXO 212.50MHZ LVPECL SMD
CFVED-A7BP-311.04TS Cardinal晶振 CFVED OSC VCXO 311.04MHZ LVPECL SMD
CFVED-A7BP-622.08TS Cardinal晶振 CFVED OSC VCXO 622.08MHZ LVPECL SMD
CFVL-A7BP-155.52TS Cardinal晶振 CFVL OSC VCXO 155.52MHZ LVDS SMD
CFVL-A7BP-156.25TS Cardinal晶振 CFVL OSC VCXO 156.25MHZ LVDS SMD
CFVL-A7BP-212.5TS Cardinal晶振 CFVL OSC VCXO 212.50MHZ LVDS SMD
CFVL-A7BP-311.04TS Cardinal晶振 CFVL OSC VCXO 311.04MHZ LVDS SMD
CFVL-A7BP-622.08TS Cardinal晶振 CFVL OSC VCXO 622.08MHZ LVDS SMD
 
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